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學生職業成果

12%

加薪或升職
可分享的證書
完成後獲得證書
100% 在線
立即開始,按照自己的計劃學習。
第 1 門課程(共 4 門)
可靈活調整截止日期
根據您的日程表重置截止日期。
中級
完成時間大約為18 小時
英語(English)

您將獲得的技能

Primality TestVerilogDigital DesignStatic Timing Analysis

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第 1 門課程(共 4 門)
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中級
完成時間大約為18 小時
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提供方

Placeholder

科罗拉多大学波德分校

立即開始攻讀碩士學位

此 課程 隸屬於 科罗拉多大学波德分校 提供的 100% 在線 Master of Science in Electrical Engineering。 如果您被錄取參加全部課程,您的課程將計入您的學位學習進程。

教學大綱 - 您將從這門課程中學到什麼

內容評分Thumbs Up93%(3,220 個評分)Info
1

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完成時間為 5 小時

What's this programmable logic stuff anyway? History and Architecture

完成時間為 5 小時
9 個視頻 (總計 46 分鐘), 5 個閱讀材料, 2 個測驗
9 個視頻
Course Overview6分鐘
1. Welcome to the world of programmable logic and FPGA design1分鐘
2. A Brief History of Programmable Logic9分鐘
3. CPLD Architecture5分鐘
4. LUTs and FPGA Architecture8分鐘
5. LUTs for Logic Design2分鐘
6. Designing Adders6分鐘
7. Designing Multipliers3分鐘
5 個閱讀材料
About This Course10分鐘
Hardware Requirements10分鐘
Introduction to FPGA Design for Embedded Systems Assessment Strategy10分鐘
Week 1 Suggested Readings1 小時 20 分
Week 2 Assignment Instructions and Files10分鐘
1 個練習
Mission 002: Week 1 Quiz30分鐘
2

2

完成時間為 4 小時

FPGA Design Tool Flow; An Example Design

完成時間為 4 小時
11 個視頻 (總計 121 分鐘), 1 個閱讀材料, 3 個測驗
11 個視頻
2. Downloading Quartus Prime2分鐘
3. Installing Quartus Prime2分鐘
4. Introducing Quartus Prime11分鐘
5. Create a design project in Quartus Prime7分鐘
6. Create a design in Quartus Prime13分鐘
7. Compile a Design17分鐘
8. View the RTL16分鐘
9. Timing Analysis with Time Quest I9分鐘
10. Timing Analysis with Time Quest II16分鐘
11. Simulate a design with ModelSim17分鐘
1 個閱讀材料
Week 2 Suggested Readings20分鐘
2 個練習
Mission 003 : Practice Opportunity30分鐘
Mission 005: Week 2 Quiz30分鐘
3

3

完成時間為 4 小時

FPGA Architectures: SRAM, FLASH, and Anti-fuse

完成時間為 4 小時
8 個視頻 (總計 80 分鐘), 2 個閱讀材料, 1 個測驗
8 個視頻
2. Xilinx CPLD Architecture7分鐘
3. Xilinx Small FPGAs8分鐘
4. Xilinx Large FPGAs11分鐘
5. Altera CPLDs and Small FPGAs8分鐘
6. Altera Large FPGAs9分鐘
7. Microsemi Single-chip FPGA solutions14分鐘
8. Lattice Single-Chip FPGA solutions14分鐘
2 個閱讀材料
Week 3 Suggested Readings1 小時 20 分
Week 4 Assignment Instructions and Files10分鐘
1 個練習
Mission 006: Week 3 Quiz30分鐘
4

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完成時間為 6 小時

Programmable logic design using schematic entry design tools

完成時間為 6 小時
10 個視頻 (總計 180 分鐘), 1 個閱讀材料, 2 個測驗
10 個視頻
2. Advanced Schematic Entry for FPGA Design- Drawing and Hierarchy26分鐘
3. Improving Productivity with IP Blocks25分鐘
4. Improving Timing with Pipelining18分鐘
5. FPGA IO: Getting In and Getting Out8分鐘
6. Pin Assignments: Making them Spot On!20分鐘
7. Programming the FPGA10分鐘
8. Becoming one with Q: Qsys System Design20分鐘
9.a Becoming one with Q Part II: Qsys System Design Finishing Touches25分鐘
9.b Becoming one with Q Part III: Qsys System Design Finishing Touches19分鐘
1 個閱讀材料
Week 4 Suggested Readings1 小時 10 分
1 個練習
Mission 008: Week 4 Quiz30分鐘

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